CPU响应中断一般是在( )

用4K×4位/片的存储芯片构成16K×8位的存储器，地址线为A₁₅(高)～A₀(低)。

问：(1)需要几片这种存储芯片?

(2)存储器共需要几位地址?是哪几位地线?

(3)加至各芯片的地址线是哪几位?

(4)用于产生片选信号的地址线是哪几位(译码法)?

设有计算机的CPU数据通路及其与存储器的连接结构如题26图所示，其中，RO～R3为通用寄存器，IR为指令寄存器，PC为程序计数器，SP为堆栈指针，C和D为暂存器，MAR为存储器地址寄存器，MDR为存储器数据缓冲寄存器，AB为地址总线，DB为数据总线，CB为控制总线。

试写出指令ADD(R3), RO的执行流程。指令功能为数据加法操作，其中，(R3)为采用寄存器间接寻址的目的操作数，RO为采用寄存器寻址的源操作数。

计算机硬件主要由哪些部分构成?

用原码一位乘的乘法方法进行5×7的四位原码乘法运算，要求写出其运算过程。

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